首先打开软件。打开之后点击画圈部分。next，然后填写工程储存位置，工程名字。工程建好之后，新建VHDL语言文件。这样就完成了，输入程序就可以了。注意事项：VHDL主要用于描述数字系统的结构，行为，功能和接口。
实验原理***：用层次化设计的方法以VHDL语言编程实现以下功能：【1】具有“时”、“分”、“秒”计时功能；时为24进制，分和秒都为60进制。
然后新建一个bdf文件，双击空白处，会跳出对话框，加入你要的模块即可。
摘要：在简要介绍同步数字复接基本原理的基础上，采用VHDL语言对同步数字复接各组成模块进行了设计，并在ISE集成环境下进行了设计描述、综合、布局布线及时序仿真，取得了正确的设计结果，同时利用中小容量的FPGA实现了同步数字复接功能。
是的，你要把写好并验证过的VHDL程序选择一种FPGA或CPLD下载烧写到芯片中，再根据芯片型号去AD查找相应器件就行了，在AD中根据FPGA布局布线时分配的引脚绘制原理图就OK。
二位10进制频率计是不是就是一个计数器可以从0计数到99啊。
电路本身描述如下：a=output；c=b***OR***Xin；if***（clk***event***and***clk=1）***then***b=a；output=c；注：***output***端口定义为：***output：***buffer***std_logic；a为output***链接至左端D触发器（dff）***的信号。
首先在运行中输入notepad，启动记事本程序。在记事本程序中输入需要在Quartus***II中录入的汉字，然后选择***。然后找到并打开Quartus***II软件，找到并双击打开目标VHDL文件。将鼠标光标插入到需要录入汉字的位置。
门电路和触发器（***1***）门电路门电路可以看成是数字逻辑电路中最简单的元件。目前有大量集成化产品可供选用。最基本的门电路有***3***种：非门、与门和或门。非门就是反相器，它把输入的***0***信号变成***1***，***1***变成***0***。
在Altium***designer软件中打开原理图，并完成元件放置和连接。以逐一检查元器件封装，也可以采用tools-footprint***manager，来统一更改元件封装。
您好，希望以下回答能帮助您***你画原理图的时候选择添加原件就可以看到自己生成的模块，然后直接添加就行***如您还有疑问可继续追问。
1、在对一个设计实体定义了外部界面后，一旦其内部开发完成后，其他的设计就可以直接调用这个实体。这种将设计实体分成内外部分的概念是VHDL系统设计的基本点。
2、其实u3：xor3***port***map***（din，r1，r2，y2）；可以写成u3：xor2***port***map***（y1，r2，y2）；，功能相同，电路更简单。
3、设计集成电路时，先编写vhdl代码，vhdl文件就是用VHDL语言编写的实现电路功能的程序。
4、VHDL语言为学生提供了概念化和设计环境的能力，交替使用不同的算法来编译电路的运行，并根据编写的代码自行进行各种模拟和测试，以使编译达到最佳效果。
5、VHDL是一种硬件描述语言，大规模集成电路设计时，先用语言描述，后综合转换成基本元件，与非门、反相器之类的。
1、quartus***II里的file目录下creat/update，然后***creat***symbol***files***for***current***file可以生成模块，然后新建一个bdf文件，双击空白处，会跳出对话框，加入你要的模块即可。
2、单元电路设计、原理及器件选择***说明电子钟的设计原理以及器件的选择，主要从石英晶体振荡器、分频器、计数器、显示器和校时电路五个方面进行说明。***绘制整机原理图***该系统的设计、安装、调试工作全部完成。
3、③用硬件设计语言来实现。常见的数字设计语言为VHDL和Verilog***本文就以JK触发器和附加门电路来演示如何设计一个七进制加法计数器时钟电路。总体步骤为：①画出计数器的状态转换图。②根据状态图得出JK各个状态变量的逻辑值。
4、画数字逻辑电路就用Quartus***II***。
5、先check***syntax（检查语法），通过后，没有问题就可以synthesize（综合），然后就可以看到rtl级的原理图，在左边processes的框框里面，点synthesize里面的VIEW***RTL***schematic。
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